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朋友悖论,指在任意社交网络中随机选取一个个体、其朋友的平均朋友数总是大于该个体自身的朋友数,所以一个人的朋友通常比他自己的朋友更多。由此也可以推断出,一个人的朋友总是更受其他人欢迎,一个人最好的朋友通常还有其他更好的朋友。 大概在小学的时候我还有一些真正意义上的朋友,因为小学里没什么学业压力,主要还是寓教于乐,那时候自己有很多喜欢做的事情,画画、观…

I2C时序分析

协议 1.空闲状态 I2C总线总线的SDA和SCL两条信号线同时处于高电平时,规定为总线的空闲状态。此时各个器件的输出级场效应管均处在截止状态,即释放总线,由两条信号线各自的上拉电阻把电平拉高。 2.起始位与停止位 起始信号:当SCL为高期间,SDA由高到低的跳变;启动信号是一种电平跳变时序信号,而不是一个电平信号。 停止信号:当SCL为高期间,…

芯片的工艺角
FPGA程序固化
芯片测试Pattern
芯片制造过程中的工艺偏差,如掺杂浓度、扩散深度、刻蚀程度等,会导致不同批次间、同批次不同晶圆间、甚至同一 晶圆上的不同芯片的工作情况都存在差异。在一片 wafer 上,每点的载流子平均漂移速度不可能都是一样的,随着电压、温度不同,它们的特性也会不同,把他们分类就有了 PVT(Process,Voltage,Temperature),而 Proces…
FPGA 固件存储 Intel 或 Xilinx 的 FPGA 芯片,使用的是基于 SRAM 结构的查找表,而 SRAM 的一大特性就是掉电数据会丢失,当使用 JTAG 将 SRAM 配置文件(.sof)配置到 FPGA 芯片中后,这些数据是直接存储在 SRAM 结构的查找表中的,因此,一旦芯片掉电,则 SRAM 中的数据将丢失,再次上电后, SR…
更新至:音乐魔方/Beyond The Ave. Final
Pattern 在芯片测试行业通常表示需要测试芯片的时序特征。在测试芯片的过程中,ATE 机台会向被测试芯片的输入管脚发送一系列的时序,而在芯片的输出管脚比较输出时序,由此测试芯片是否满足其功能。狭义上可以将测试 pattern 理解为芯片的真值表。 与 IC 设计产生的时序不同,一般测试用的 Pattern 中的时序都是分割好周期的。而不同 AT…
没想到自己第一次体验滑雪是在浙江。 虽然猛猛摔了四五次,不过滑雪真的很好玩,而且基本上掌握平衡和技巧以后就很简单,大概完整下了两次坡以后就不会再摔了。 总结了一下双板入门技巧,第一是身体重心要一直向前倾,一定不能怕摔,越是怕越容易摔;第二是先在平地上用雪杖往后撑着慢慢往前滑,练习平衡和刹车控制速度,两只脚要平行或者内八,改变重心在左脚就会往右转弯,…
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